[VLSI] 디지털 회로의 Power(3) - 18EE
https://18electronics.tistory.com/22 [VLSI] 디지털 회로의 Power(1) - 18EE 현재 디지털 회로를 구성할 때 중요한 trade off 중 하나는 speed와 power이다. 딜레이에 관한 내용은 정리해놓았다. https://18electronics.tistory.com/19 [VLSI] 디지털 회로의 Delay(1) - 18EE CMOS 특성 디지털 회로 18electronics.tistory.com cf) fsw : switching activity factor를 고려한 transition frequency 개선점 방법 및 trade off Lower VDD - 가장 효과가 좋은 방법이다. - Speed와 trade off 관계이므로 쉽게 줄일 수 없다. - ..
이론/VLSI
2023. 8. 2. 20:44
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